DSP开发技术 (BM: chaosboy wbs)
发信人: kamachi (杰子), 信区: DSPTech
标 题: adsp系列的主机和adsp21xx核分别是什么概念？
发信站: BBS 水木清华站 (Mon Jun 3 09:28:31 2002)
谁帮我解释一下？
thx
--
※ 来源:·BBS 水木清华站 smth.edu.cn·[FROM: 202.192.157.41]
发信人: gcup (麻烦呀，咋办来), 信区: DSPTech
标 题: Re: adsp系列的主机和adsp21xx核分别是什么概念？
发信站: BBS 水木清华站 (Mon Jun 3 09:31:26 2002)
adsp21xx仅仅是2151－2181，89等一系列定点片子吧
而所谓adsp系列除了上诉的之外还应该包括什么210xx等浮点片子
【 在 kamachi (杰子) 的大作中提到: 】
: 谁帮我解释一下？
: thx
--
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※ 来源:·BBS 水木清华站 smth.edu.cn·[FROM: 166.111.66.227]
发信人: kamachi (杰子), 信区: DSPTech
标 题: Re: adsp系列的主机和adsp21xx核分别是什么概念？
发信站: BBS 水木清华站 (Mon Jun 3 09:31:45 2002)
没人弄过ad公司的DSP芯片吗？
【 在 kamachi (杰子) 的大作中提到: 】
: 谁帮我解释一下？
: thx
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※ 来源:·BBS 水木清华站 smth.edu.cn·[FROM: 202.192.157.41]
发信人: kamachi (杰子), 信区: DSPTech
标 题: Re: adsp系列的主机和adsp21xx核分别是什么概念？
发信站: BBS 水木清华站 (Mon Jun 3 09:32:29 2002)
我知道。。
芯片核以及主机是什么概念？
【 在 gcup (麻烦呀，咋办来) 的大作中提到: 】
: adsp21xx仅仅是2151－2181，89等一系列定点片子吧
: 而所谓adsp系列除了上诉的之外还应该包括什么210xx等浮点片子
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※ 修改:·kamachi 於 Jun 3 09:32:58 修改本文·[FROM: 202.192.157.41]
※ 来源:·BBS 水木清华站 smth.edu.cn·[FROM: 202.192.157.41]
发信人: gcup (麻烦呀，咋办来), 信区: DSPTech
标 题: Re: adsp系列的主机和adsp21xx核分别是什么概念？
发信站: BBS 水木清华站 (Mon Jun 3 09:35:27 2002)
芯片不用说了吧，核可以通过这么一个事实理解：很多种双cpu的芯片就包括一个ad2181
的核和一个8051的核，至于主机，我觉得是相对于显示器而言的，哈哈
【 在 kamachi (杰子) 的大作中提到: 】
: 我知道。。
: 芯片和核已经主机是什么概念？
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发信人: kamachi (杰子), 信区: DSPTech
标 题: Re: adsp系列的主机和adsp21xx核分别是什么概念？
发信站: BBS 水木清华站 (Mon Jun 3 09:35:59 2002)
偶在看定点的HIP操作时看到这句话：
对于主机来说，HDR就象存储器的一部分，对于ADSP-21XX核来说，
HDR是存储器映射寄存器，是内部数据存储器的一部分
请问这里的主机和核是什么概念呢？
【 在 gcup (麻烦呀，咋办来) 的大作中提到: 】
: adsp21xx仅仅是2151－2181，89等一系列定点片子吧
: 而所谓adsp系列除了上诉的之外还应该包括什么210xx等浮点片子
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※ 来源:·BBS 水木清华站 smth.edu.cn·[FROM: 202.192.157.41]
发信人: gcup (麻烦呀，咋办来), 信区: DSPTech
标 题: Re: adsp系列的主机和adsp21xx核分别是什么概念？
发信站: BBS 水木清华站 (Mon Jun 3 09:38:29 2002)
哦，诚恳的说，我胡涂了，我想不出来对于什么而言，hdr居然就象存储器的一部分
呵呵，偶不知的说
【 在 kamachi (杰子) 的大作中提到: 】
: 偶在看定点的HIP操作时看到这句话：
: 对于主机来说，HDR就象存储器的一部分，对于ADSP-21XX核来说，
: HDR是存储器映射寄存器，是内部数据存储器的一部分
: 请问这里的主机和核是什么概念呢？
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发信人: kamachi (杰子), 信区: DSPTech
标 题: Re: adsp系列的主机和adsp21xx核分别是什么概念？
发信站: BBS 水木清华站 (Mon Jun 3 09:39:31 2002)
可以理解：主机是PC吗？
【 在 gcup (麻烦呀，咋办来) 的大作中提到: 】
: 哦，诚恳的说，我胡涂了，我想不出来对于什么而言，hdr居然就象存储器的一部分
: 呵呵，偶不知的说
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※ 修改:·kamachi 於 Jun 3 09:40:32 修改本文·[FROM: 202.192.157.41]
※ 来源:·BBS 水木清华站 smth.edu.cn·[FROM: 202.192.157.41]
发信人: kamachi (杰子), 信区: DSPTech
标 题: Re: adsp系列的主机和adsp21xx核分别是什么概念？
发信站: BBS 水木清华站 (Mon Jun 3 09:41:26 2002)
这可是AD公司产品演示发布会上发给我的资料呀。。
难道有错？
照抄过来的。。呵呵
【 在 gcup (麻烦呀，咋办来) 的大作中提到: 】
: 哦，诚恳的说，我胡涂了，我想不出来对于什么而言，hdr居然就象存储器的一部分
: 呵呵，偶不知的说
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※ 来源:·BBS 水木清华站 smth.edu.cn·[FROM: 202.192.157.41]
发信人: gcup (麻烦呀，咋办来), 信区: DSPTech
标 题: Re: adsp系列的主机和adsp21xx核分别是什么概念？
发信站: BBS 水木清华站 (Mon Jun 3 09:55:17 2002)
哈哈，知道了，主机是主从关系的主机，可以是另一款dsp，可以是单片机，当然也可以
是pc，只不过是一对通信中断中处于主位的一个，呵呵，这需要上下文
The HIP consists of three functional blocks, shown in Figure 7.1: a host
control interface block (HCI), a block of six data registers (HDR5-0) and a
block of two status registers (HSR7-6). The HIP also includes an associated
HMASK register for masking interrupts generated by the HIP. The HCI
provides the control for reading and writing the host registers. The two
status registers provide status information to both the host and the ADSP-
21xx core.
The HIP data registers HDR5-0 are memory-mapped into internal data
memory at locations 0x3FE0 (HDR0) to 0x3FE5 (HDR5). These registers
can be thought of as a block of dual-ported memory. None of the HDRs
are dedicated to either direction; they can be read or written by either the
host or the ADSP-21xx. When the host reads an HDR register, a maskable
HIP read interrupt is generated. When the host writes an HDR, a
maskable HIP write interrupt is generated.
【 在 kamachi (杰子) 的大作中提到: 】
: 可以理解：主机是PC吗？
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发信人: kamachi (杰子), 信区: DSPTech
标 题: Re: adsp系列的主机和adsp21xx核分别是什么概念？
发信站: BBS 水木清华站 (Mon Jun 3 09:57:20 2002)
good
thx
【 在 gcup (麻烦呀，咋办来) 的大作中提到: 】
: 哈哈，知道了，主机是主从关系的主机，可以是另一款dsp，可以是单片机，当然也可以
: 是pc，只不过是一对通信中断中处于主位的一个，呵呵，这需要上下文
: The HIP consists of three functional blocks, shown in Figure 7.1: a host
: control interface block (HCI), a block of six data registers (HDR5-0) and a
: block of two status registers (HSR7-6). The HIP also includes an associated
: HMASK register for masking interrupts generated by the HIP. The HCI
: provides the control for reading and writing the host registers. The two
: status registers provide status information to both the host and the ADSP-
: 21xx core.
: The HIP data registers HDR5-0 are memory-mapped into internal data
: memory at locations 0x3FE0 (HDR0) to 0x3FE5 (HDR5). These registers
: ...................
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